"4bit Timing Signal G" 검색결과 1-20 / 50건

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  실험4 예비 5_마이크로프로세서 실험 및 설계 실습8. 타이머를 이용한 디지털 시계

  PINPORTG=0x0F;//0~4비트까지의 register중에서 0~3비트까지의 register를 사용하여 입력한다.TCCR0=0x07;//0~7비트까지의 모든 register ... ){print_FND(C3, time_s%10);//4번쨰 COM 에 1초단위 출력_delay_ms(1);print_FND(C2, time_s/10);// 3번쨰 COM에 10초단위 출력 ... ){case C3: //4번쨰 FND (좌측기준)PORTG&=0xF0; //하나씩만 입력하기 위해서 그 전의 내용을 초기화 시킴PORTG|=0x07;//포트G의 G0를 사용하여 C3

  리포트 | 5페이지 | 2,000원 | 등록일 2020.01.02 | 수정일 2020.11.12

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  마이크로프로세서+6주차+결과보고서-실습8 Timer를 이용한 디지털 시계

  );print_FND(C0, time_m/10);_delay_ms(1);}return 0;}SIGNAL(SIG_OVERFLOW0){cli();TCNT0 = 0xFF - 80;timer0Cnt ... 함수를 사용할 것임을 나타냄오버플로우로 인터럽트 발생 (0번 타이머/카운터이용)메인함수 시작포트 E를 모두 출력으로 사용포트 E의 데이터값은 00000000포트 G를 0~3비트 ... 라는 타입을 이용해서 지정한다. C0 ~ C3는 가독성을 위해서 이렇게 작성한다.● 코드에서 while안의 반복문에 _delay_ms(1) 4번은 잔상을 주기위해서 0.0111초를 오버

  리포트 | 9페이지 | 2,000원 | 등록일 2020.01.02 | 수정일 2020.11.12

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  LG하우시스 경력 PPT 자료

  PHY, 3G/CDMA/HSDPA Module Interface - 환경 시험 대응 : EMI(EN55022 ClassA B , ESD(Contact ±12kV Air ±15kV ... 의 GPS 데이터를 저장하고 서버와 통신하여 위치정보를 전송 담당업무 - 회로설계 : MCU(MSP430F4x, Atmega64), SPI NAND, 수압센서 Current 를 AMP ... 시험 대응 : EMI(EN55022 ClassA B , ESD(Contact ±4kV Air ±8kV), 온습도 (-15~65 도 /95%) 특수 목적용 네비게이션 특수 네비게이션

  자기소개서 | 5페이지 | 3,000원 | 등록일 2018.12.19 | 수정일 2019.01.23

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  제어계측공학과 졸업작품 『블루투스 RC카』

  PORT F(PF0~PF7)54~618비트 입력 포트, ADC에 대한 아날로그 입력PORT G(PG0~PG4)18, 19, 33, 34, 43내부 풀업 저항이 있는 5비트 양방향 ... dbm-비트 속도 : EDR, 최대 3Mbps까지-인터페이스 : UART-안테나 : 내장-전압 : 3.1 4.2VDC-현재 : 40mA 최대-크기 : 27 * 13 * 2mm2.6 ... 적으로 스마트폰으로 RC Car를 조종하고 장애물 접근 시 충돌을 방지하는 동작 제어를 목표이다.2012년 3분기 스마트폰 시장의 점유율을 보면 전년 동기 대비 2.4% 성장한 4억

  논문 | 24페이지 | 4,000원 | 등록일 2020.05.31 | 수정일 2020.06.07

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  ATmega128을 이용한 디지털 카운터 제작 프로젝트(소스 및 동영상 포함)

  Modulator) – 발진회로와 분리된 실시간 카운터 (Real Time Counter) – 8 채널의 10 비트 ADC(Analog to Digital Converter ... 포트 • 포트 A ~ 포트 G 포트 : 53 개의 디지털 입출력 핀 – A~F : 8 비트 , G : 5 비트 • 모두 특수한 기능을 공유하여 사용하고 있음 – 기타 핀 • 전원 ... x0F; /* control port 0-3 PIN 0~4 비트까지의 register 중에서 0~3 비트까지의 register 를사용하여 출력한다 . */ PORTG = 0x0F

  리포트 | 29페이지 | 3,000원 | 등록일 2017.01.23

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  AVR 마이크로 프로세서 ATmega128 을 이용하여 시계, 스탑 워치, 알람, 다운 카운터 실험 설계 프로젝트 (코드 포함)

  F 6개양방향 5bit I/O port G 1개3개의 레지스터에 의해 제어 : DDRx(신호의 방향 결정), PORTx(출력 데이터), PINx(입력 데이터)timer 4개 ... ;print_FND_2bit(min, mode_sel, FND_DOWN[4]);PORTG=0x00; //포트G입력으로 이용if(sw2==1){FND_SEL_CNT++;if(FND_SEL ... 부터 시간char LAP_TIME[4][4]={{0, 0, 0, 0}, {0, 0, 0, 0}, {0, 0, 0, 0}, {0, 0, 0, 0}};//using in mode_1 to s

  리포트 | 29페이지 | 5,000원 | 등록일 2017.01.11

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  ATMEGA128을 이용한 교통신호 제어

  함수가 켜져 있다면{LED_DATA = 0x10;//4비트 출력if(time_count==1000)//10초가 됫다면{if(buzzer==1)//이것이 인터럽트0에 의해서 발동 되 ... 으로 Push 버튼을 GPIO에 연결하고 인터럽트로 처리한다.3. 신호등의 순서는 G->Y->R 순으로 바뀐다.4. G, R 의 신호는 10초동안 유지한다.5. G->R로 신호가 바뀔 때 ... xFF;//0,2,4 비트 LED 출력 (그린 , 옐로우 , 레드)순서EICRA = 0x03;//인터럽트 상승에지 사용EICRB = 0x00;EIMSK = 0x01;//인터럽트 0

  리포트 | 5페이지 | 1,000원 | 등록일 2015.06.25 | 수정일 2015.09.20

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  ATMEGA128을 이용한 AVR 환경에서 스톱워치만들기

  )포트-E : Array FND 모듈의 A~H 에 연결 (8핀 연결)포트-G : Array FND 모듈의 C0~C3 연결 (4핀 연결)Array FND 모듈A~H 핀 (FND에 표시 ... Time_STOP = 0;SIGNAL(SIG_INTERRUPT0);SIGNAL(SIG_INTERRUPT1);int main(){unsigned char FND_DATA_TBL ... (time_1m == 10){time_1m = 0;time_10m++;}if(time_10m == 6){time_10m = 0;}}return 0;}SIGNAL(SIG

  리포트 | 5페이지 | 1,500원 | 등록일 2015.06.25 | 수정일 2020.12.27

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  실험4)인터럽트 실습 5, 6

  Enablesei();-Main 루틴 기술-인터럽트 서비스 루틴의 선언SIGNAL(인터럽트소스명); 방식을 사용4) 인터럽트란??대부분의 마이크로프로세서는 한번에 하나의 프로그램 ... #include #include #include unsigned char Time_STOP = 0;SIGNAL(SIG_INTERRUPT0);int main(){unsigned c ... ;}_delay_ms(100);}return 0;}SIGNAL(SIG_INTERRUPT0){cli();if(Time_STOP == 0 )Time_STOP = 1;elseTime

  리포트 | 8페이지 | 1,500원 | 등록일 2015.11.12

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  [VerilogHDL] CLA를 이용한 16bit 산술논리장치(ALU) 설계

  = Ai · Bi + (A Bi) · Ci = Gi + Pi · Ci각 비트의 Carry outC1 = G0 +P0 · C0C2 = G1 +GO · P1+P0 · P1 · C0C ... 3술논리장치는 4bit 산술논리장치를 4개를 연결하여 설계한다.([그림 3])■ 회로구현게이트레벨구조의 CLA를 이용한 16bit ALU 코드//------------------- ... ---------------4-bit ALU Module----------------------//module ALU4(A, B, S0, S1, X, Y, M);input [3:0

  리포트 | 6페이지 | 3,500원 | 등록일 2015.08.02

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  통신실험 프로젝트 PPT

  signal : 1.5V Code Number : 5 PCM sequence : 101 4Companding Reason for companding is higher SNR(Signal ... logNo=100015179486 [3 ] 통신 시스템 공학 (ELECTRONIC COMMUNICATIONS SYSTEMS) - ROY BLAKE 저 [4 } g.xxx 계열 음성 ... Compression law 2Sampling the analog signal with uniform time interval. Specific range of signals quantized

  리포트 | 20페이지 | 2,500원 | 등록일 2013.12.19

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  예비보고서-오실로스코프사용법,리사쥬도형에의한주파수측정

  의 정밀도를 나타내는 bit로 품질을 결정하는데, 속도가 빠를 수록 그리고 비트수가 많을 수록 비싸고 좋다라고 말한다. 그것도 변환속도가 너무 빠르면?한계가 있다. 따라서 위 ... 에는 아날로그 방식을 사용 하였으나 지금은 디지털화 되었고, 최근에는 디지털 신호를 표시하는 Mixed Signal 장비가 많다.즉, 오실로스코프와 로직아날라이저가 하나의 장비에 장착된 것 ... 는 :1. Deflection voltage electrode2. Electron gun3. Electron beam4. Focusing coil5. Phosphor-coated

  리포트 | 14페이지 | 1,000원 | 등록일 2016.02.03 | 수정일 2016.12.01

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  디지털미디어 원리 및 실습 중간고사 내용 정리

  Bit?스테레오(Stereo)?필요한 비트 율은??16 X 44100 X 2 = 1.4Mbps?MPEG에서는 약128~256Kbps오디오압축?압축 기법?소스 코딩(source c ... 을 취함상데이터를 불연속적인 디지털데이터로 변환하는 과정?각 화소의 밝기 또는 색을 컴퓨터에서 인지할 수 있는 숫자로 표현?표현할 수 있는 색상의 수가 2G일 경우?G비트 양자화?8 ... 화 과정에 사용되는 비트 수는 신호대 잡음의 비율인 S/N(Signal to Noise)비와 진폭의 최고점과 최저점 사이의 범위(Dynamic Range)를 고려하여 결정양자화스텝크기

  시험자료 | 20페이지 | 1,500원 | 등록일 2016.05.06 | 수정일 2016.05.10

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  4bit Timing Signal Generator

  Digital Logic CircuitReport : 4bit Timing Signal Generator박선우 교수님제출일자 : 2009. 11. 17(水)2005890010 ... 을 볼 수 있다.3. 고찰4-Bit Timing Generator를 설계하여 확인하는 프로젝트이었다. 소프트웨어는 Multisim2000을 사용하였다. 이 실험에서는 D플립플롭 4개 ... 었다. Load와 Counter 를 제어할수 있게 하는 회로를 Logic Converter를 이용하여 설계하였다.4. 참고문헌1. 가장 쉬운 Digital 전자회로 Circuit 실험2

  리포트 | 7페이지 | 1,000원 | 등록일 2009.12.03

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  [VerilogHDL] CLA(Carry Look ahead Adder)를 이용한 16bit 고속 가산기 설계

  1 · P2 · C0C4 = G3 +G2 · P3+G1 · P2 · P3 +G0 · P1 · P2 · P3 + P0 · P1 · P2 · P3 · C0그림2. 4bit Carry ... 하는 방식으로구조는 간단한 반면 bit의 개수가 많아질수록 속도가 느려지는 단점이 있다.그림1. 4bit Binary Parallel Adder■ CLA(Carry Look ... · Ci- 각 비트의 Carry outC1 = G0 +P0 · C0C2 = G1 +GO · P1+P0 · P1 · C0C3 = G2 +G1 · P2+G0 · P1 · P2 +P0 · P

  리포트 | 6페이지 | 2,500원 | 등록일 2013.05.25

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  Viterbi Decoder

  가 수신을 하고 3비트 양자화기로 양자화된다. 양자화된 숫자는 -4에서 3까지 표현할 수 있는 2의 보수로 나타내어진다. 1비트가 아닌 1비트 이상으로 (multi-bit) 양자 ... 다. 이 콘볼루션 부호화기의 블록도는 그림 1에 나타내었다. x(n)은 입력이고 G0(n) 및 G1(n)은 부호화된 출력이다. 콘볼루션 부호화기의 코딩율은 출력비트에 대한 입력비트 ... 에서 볼 때 시간의 진행의 과정으로 발생한 비트쌍 이 전송되는 것이다.만일 11이 전송되었다고 가정하면, 이상적인 경우 연판정 결과가 (-4, -4)일 것이라고 기대하게 된다

  리포트 | 9페이지 | 1,000원 | 등록일 2012.11.21

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  VHDL을 이용한 TLC설계,개선사항,Traffic light controller설계 집적설계

  Bar Person FND mode Green1 Count4 Street Traffic Signal Controller Design Initial state : south- north ... ] CurrentState NextState clock reset Car_Sync (4-bit) Count = 5 Count = 30 Count1 = 20 Count1 = 35 TS TL TM2 ... demand The signal system should be accurate Should not break the flow of traffic Maximum waiting time s

  리포트 | 25페이지 | 1,000원 | 등록일 2010.06.05

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  HSDPA의 모든 것(워드로 작성 한 57페이지 분량)

  CE보이며 전송방법도 다르다. IMT-2000이 교환기인 ATM(비동기 전송모드) 기반인 데 반해, 4G는 인터넷 프로토콜(IP)인 라우터를 기반으로 한다.또 현재 이동통신(=무선인 ... 어디에서나 유․무선의 경계를 인식하지 않아도 되는 기술이 4G가 구현하여야 할 궁극적 목표이다.그림 SEQ 그림 \* ARABIC 10 차세대(4G) 이동통신망 구조제 3 장 ... , 3G 이동통신 인WCDMA(Rel. 4)에 비해 최대 7배 빠른 속도를 가진다. FDD 모드 및 광 대역 TDD모드 HSDPA는 5MHz대역 내에서 3.84Mcps의 칩 율

  리포트 | 58페이지 | 3,500원 | 등록일 2011.05.16

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  통신실험 결과보고서(Unit8)

  exist;3. to be honest and realistic in stating claims or estimates based on available data;4. to ... amplitude of a signal or of specific frequencies of a signal.4) flat-top sampling - a type of s ... ampling in which the amplitude of each pulse remains constant during the sampling time.5) quantize - to c

  리포트 | 10페이지 | 2,500원 | 등록일 2013.12.19

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  [디스플레이 시스템 실험] LCD panel의 광학적 특성

  time을 측정하고, G to G 와 B to W의 차이를 비교한다.5.4 추가실험. Buffer Board를 통한 광학 특성을 AD Board를 통했을 때의 Lookup Table ... 을 측정 하여 LCD panel의 고유 특성을 알 수 있다. 액정의 Response Time을 직접 측정함으로써 G to G, B to W 간의 차이 또한 알아볼 수 있다.2 ... ‘표5’는 0 to 128(=B to G, G to B)의 파형으로 Response time은 20+2=22 ms가 된다. B to W의 Response time보다 Response

  리포트 | 33페이지 | 5,000원 | 등록일 2011.08.10

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