"디지털 논리실험" 검색결과 101-120 / 3,243건

• 

  디지털 회로 실험 및 설계 - 기본 논리 게이트(Gate) 및 TTL, CMOS I.F 실험 2

  디지털회로실험및설계 결과 보고서 #1( 기본 논리 Gate 및 TTL, CMOS I/F 실험 )과 목담당교수제 출 일학 번이 름1. 회로도, 이론값, 실험결과실험 1) 전압 ... 4.4V4.4V3V0V0V0V0V0V0V0V0V논리레벨HHLLLLLLLLL실험결과)0.0V 0.5V 1.0V1.5V 2.0V 2.5V 3.0V3.5V 4.0V 4.5V 5.0V입력 ... Level 측정실험 : 입력전압 변화에 따른 출력전압의 상태를 측정하고 기록하시오.이론값)입력전압0.0V0.5V1.0V1.5V2.0V2.5V3.0V3.5V4.0V4.5V5.0V출력전압

  리포트 | 14페이지 | 3,000원 | 등록일 2023.09.22

  다운로드 장바구니
• 

  VHDL과 FPGA 실습 키트를 이용한 묵찌빠 게임 [디지털논리회로 실험 Term Project]

  하여 스타크래프트 경기를 준비하고 있다고 들었 다. 세계적인 추세에 힘입어 우리는 묵지빠 게임에 인공지능을 넣고 실험 키트를 이용하여 게임을 하 면 재밌을 것이라 생각하게 되 ... 었고, ‘Alpha 묵지빠 2017‘을 기획하게 되었다. 실험 키트를 통한 데이터 학습이 가능하지 않아 초기에 기획한 대로 진행되지는 않았지만 인공지능의 기초인 ‘규칙 기반

  리포트 | 28페이지 | 4,000원 | 등록일 2020.04.24 | 수정일 2020.04.27

  다운로드 장바구니
• 

  서강대학교 디지털논리회로실험 6주차 - Flip-flops and registers

  하고 ISE의 simulation 기능에 대해 배운다.2. 실험 이론● Sequential logic circuitCombinational logic circuit ; 조합 논리회로 ... 1. 실험 목적Flip-flop의 종류를 파악하고, setip time과 hold time을 배우고 각각의 동작원리를 이해한다. 그리고 Registers의 동작원리를 이해 ... logic circuit ; 순차 논리회로에서는 이전의 회로 상태가 다음 출력에 영향을 미치는데, 이는 보통 활성화되는 주기를 가진 clock이라는 신호에 의해 출력이 결정되는 시점

  리포트 | 24페이지 | 1,500원 | 등록일 2024.08.17

  다운로드 장바구니
• 

  두더지 잡기 verilog with BGM ( A+ 프로젝트 결과물, 논리회로실험, 디지털시스템실험 )

  디지털 시스템 실험 ( 논리 설계 실험 ) 최종 프로젝트 과제입니다.두더지 잡기 게임이며, 게임 시작과 동시에 음악도 재생됩니다.A+ 받았으며 퀄리티 보장합니다.

  리포트 | 1페이지 | 10,000원 | 등록일 2020.11.14 | 수정일 2020.11.19

  다운로드 장바구니
• 

  서강대학교 디지털논리회로실험 - 실험 7. Finite State Machines 예비 보고서

  디지털논리회로실험예비 보고서[8주차]실험 7. Finite State Machines1. 실험 목적1) Finite state machine (FSM) 회로를 설계하고 분석할 수 ... 고 Clear=0인 경우 J, K 값에 관계없이 Q=0이 된다. 실험에서는 Preset과 Clear에 모두 HIGH 신호를 인가하고 실험을 진 행한다. 핀 배열은 [그림 6]과 같 ... : 2-Input OR gate4. 실험 과정 및 예상 결과1) 중간고사 1-(a)번의 회로를 TTL과 FPGA(schematic)로 구현하여 동작 확인최소화된 상태표 및 카르노맵

  리포트 | 12페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

  다운로드 장바구니
• 

  서강대학교 디지털논리회로실험 - 실험 7. Finite State Machines 결과 보고서

  디지털논리회로실험결과 보고서[8주차]실험 7. Finite State Machines1. 실험 개요1) Finite state machine (FSM) 회로를 설계하고 분석할 수 ... 있는 능력을 갖춘다.2) Mealy와 Moore state machine을 구분하고 각각의 특성을 이해한다.3) 비동기 counter의 동작을 분석한다.2. 실험 결과 및 분석1 ... ) 중간고사 1-(a)번의 회로를 schematic으로 구현하여 시뮬레이션이번 실험에서는 schematic으로 그린 회로를 키트에 FPGA로 구현하지 않고, 시뮬레이션으로 그 동작

  리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 3주차 예비보고서 A+

  는지 확인할 수 있습니다. 기본 실험 (1) 회로의 경우 (00, 01, 10, 11)에 대한 디코딩 게이트는 각각 (Y0, Y1, Y2, Y3)이고, 어떤 input 이냐에 따라서

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 5주차 예비보고서 A+

  1.1 4.1 기본 실험 (2)의 전가산기 [그림 2]는 반가산기 [그림 1] 두 개와 하 나의 OR 게이트로 이루어져 있다. [그림 2] 의 회로가 전가산기로 동작하는 원리 ... 하게 됩니다.1.2 응용 실험 (1), (2)의 회로를 구현하시오.응용 실험 (1)응용 실험 (2) Σ3, Σ2, Σ1의 결과는 LED를 통해 확인할 수 있습니다.

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 8주차 예비보고서 A+

  1.1 Gated D Latch의 동작에 대해 설명하시오.Gated D Latch의 경우 오직 하나의 입력 (D)과 EN 입력만을 가지고 있습니다. EN이 HIGH 일 때, D가 HIGH 면 Latch는 Set 상태이고 D가 LOW 이면 Latch는 Reset 상태입니..

  리포트 | 6페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 1주차 예비보고서 A+

  1. 실험 준비1.1 AND 게이트 7408의 datasheet를 읽는 법을 간단하게 서술하고 기본 실험 (1)의 회로를 어떻게 결선하여야 하는지 pin 번호를 이용하여 설명하시

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.03.24

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 9주차 예비보고서 A+

  1.1 8-bit Serial-in Parallel-out Shift Register 74164의 datasheet를 확인하고 (MR)’의 역할에 대하여 설명하시오. 왜 입력이 A와 B로 나누어져 있는지 설명하시오.우선 8-bit Serial-in Parallel-ou..

  리포트 | 6페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 4주차 예비보고서 A+

  들과 각각 mapping 시켜서 부호화하는 것이고, 멀티플렉서는 데이터 선택기라고도 불리는데 여러 디지털 입력 데이터 중에서 어떤 데이터를 출력할 것인지 데이터 선택 입력 의 조합

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 7주차 예비보고서 A+

  1.1 S-R Latch와 S’-R’ Latch의 동작에 대해 설명하시오.S’-R’ Latch는 일종의 메모리 역할을 할 수 있는 device라고 볼 수 있습니다. 즉, 두 가지 상 태 (Set, Reset)를 Q에 쓰기도 하고 그 상태를 저장할 수도 있습니다. 예를 ..

  리포트 | 7페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 10주차 예비보고서 A+

  1.1 비동기식 카운터와 동기식 카운터의 작동원리와 차이점에 대하여 서술하 시오.기본적으로 특정한 state이 반복적으로 어떤 주기를 가지고 발생하면 카운터의 기능을 수행 할 수 있습니다. 비동기식 카운터와 동기식 카운터의 경우 특정한 state이 반복적으로 발생 하는..

  리포트 | 6페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 2주차 예비보고서 A+

  1.1 NAND 게이트 7400, NOR 게이트 7402, XOR 게이트 7486의 datasheet를 확인하시오.우선 IC 칩들을 동작하게 하기 위해서 각각의 칩들에 Vcc와 GND를 몇 번 pin에 연결해야 하는지 확인해야 하고, 사용할 게이트 각각에 대해서..

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  서강대학교 디지털논리회로실험 - 실험 3. Decoders and Encoders 예비 보고서

  디지털논리회로실험예비 보고서[3주차]실험 3. Decoders and Encoders1. 실험 목적1) 일반적인 binary decoder의 동작 원리를 이해한다.2) 7-s ... ) Decoder하나의 코드 체계를 다른 코드 체계로 변환하는 논리 회로이며 일반적으로 입력이 출 력에 비해 더 적은 bit수를 갖는다. 대표적으로 n-to-2^{ n} binary ... 므로 논리 회로는 [그림 4]처럼 구현될 수 있다.[그림 4]2) EncoderDecoder와 반대의 기능을 하는 논리 회로이며 일반적으로 입력이 출력에 비해 더 많 은 bit수를 갖

  리포트 | 11페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

  다운로드 장바구니
• 

  서강대학교 디지털논리회로실험 - 실험 3. Decoders and Encoders 결과 보고서

  디지털논리회로실험결과 보고서[3주차]실험 3. Decoders and Encoders1. 실험 목적1) 일반적인 binary decoder의 동작 원리를 이해한다.2) 7-s ... 다.3. 토의실험 1에서는 code converter를 구현하였다. 과정 1-A ~ 1-C에서 각기 다른 방법으로 [표 1]의 진리표를 만족하는 논리 회로를 구현해 보았는데, 같 ... egment의 동작 원리를 이해한다.3) Priority encoder의 동작 원리를 이해한다.4) FPGA와 VHDL을 이용한 회로의 구현 방식을 이해한다.2. 실험 결과 및 분석1

  리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

  다운로드 장바구니
• 

  홍익대학교 디지털논리실험및설계 6주차 예비보고서 A+

  1.1 ALU 74181의 datasheet을 읽고 네 자리 이진수의 덧셈을 74181을 이용 하여 어떻게 구현할 수 있는지 설명하시오.ALU 74181은 많은 기능들이 내장되어 있는데, 네 자리 이진수 (A3 ~ A0), (B3 ~ B0) 두 개의 입력에 대해서 어떤..

  리포트 | 4페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

  다운로드 장바구니
• 

  디지털 논리 회로 설계 실험 최종프로젝트 레포트 A+ 타이밍게임(회로도있음)

  디지털 논리 회로 설계-타이밍게임_20180619000 교수님000 조교님금요일 2,3교시B000000 000-목차-(1) 설계 아이디어(2) 설계 방법(3) 전체 회로도(4

  리포트 | 11페이지 | 2,000원 | 등록일 2021.07.09

  다운로드 장바구니
• 

  디지털 논리회로 - 이론 및 실험 (생능출판 김종현), 2장 연습문제

  리포트 | 12페이지 | 2,000원 | 등록일 2022.10.08

  다운로드 장바구니