"중앙대학교 아날로그 설계실습" 검색결과 81-100 / 402건

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  [A+]중앙대 아날로그및디지털회로설계 실습 예비보고서12 stopwatch 설계

  -segment를 활용한 실습을 진행시 먼저 type을 확인해야 한다.- BCD to 7-Segment decoder디지털 회로의 출력은 대게 2

  리포트 | 11페이지 | 1,000원 | 등록일 2022.09.08 | 수정일 2022.09.16

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  중앙대 아날로그 및 디지털 회로 설계 실습 3학년 2학기 stopwatch설계 예비

  아날로그 및 디지털회로 설계 실습14주차 예비: Stopwatch 설계전자전기공학부20160000 하대동고릴라설계실습 방법에 나온 Stopwatch 제작 과정 중, 12-4-1 ... 이 표시될 것으로 예상된다. 실습11. 카운터 설계의 10진 비동기 카운터 설계 부분에서도 10이 아주 짧게 나왔기 때문이다.실습 11에서 10진 비동기 회로의 출력 아래 그래프 ... 에 2자리 BCD카운터가 카운팅을 한다. 다만 이 경우 약간의 딜레이가 발생한다. 따라서 아래와 같이 회로를 설계했다.( MC14511B 3번 핀(bar{LT}, lamp test

  리포트 | 12페이지 | 2,000원 | 등록일 2020.12.23

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 7차예비보고서-논리함수와 게이트

  장비>오실로스코프 : 1 대브레드보드 : 1 개파워서플라이 : 1 대함수발생기 : 1 대점퍼선 : 다수3-2 NAND 게이트 설계 및 특성 분석(A) Vcc 를 5V(논리값 ... 1)에서 0V(논리값 0)로 단계적으로 변화시켜서 NAND 게이트가 동작하는 최소 정격 전압을 구하는 설계 방법을 생각하고, 그 단계적 방법을 구체적으로 서술한다.: 최소 정격 ... Vcc 가 pull up network 의 PMOS 에게 overdrive voltage 이상의 전압을 제공하지 못한다면, PMOS 는 동작하지 않아 cut-off 가 될 것이다. 이를 바탕으로 설계 방법을 생각하자.

  리포트 | 6페이지 | 1,000원 | 등록일 2021.10.06

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  A+ 중앙대 아날로그및디지털회로설계실습(결과)4. 신호 발생기

  (보고서 작성에 참고한 문헌을 번호로 나열하며 본문에서 인용된 부분에 이 번호를붙인다.)1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, pp 44-45 ... 을 변화를 시키고, 다이오드를 추가하며 소자의 값을 조절하여 원하는 주파수와 크기를 설정하여 왜곡을 줄일 수 있다.2. 실험결과4-4. 설계 실습 내용 및 분석4-4-1 설계 ... 다.다이오드를 추가시키자 왜곡이 감소한 안정된 출력이 발생하였다. 발진주파수의 최대치 1.96kHz이다.4-5-2 설계 사양에 따라 설계실습계획서에서 설계한 회로가 실제 구현

  리포트 | 4페이지 | 1,000원 | 등록일 2022.09.10

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  [A+]중앙대 아날로그및디지털회로설계 실습 예비보고서2 SMPS

  1. 실습을 위한 이론적 배경:-SMPS : 일정한 전류 출력 전압을 부하에 공급해주는 직류 안정화 전원이다. DC-DC 컨버터 에 있어서 부품의 기생 요소들에 의하여 부하 변동 ... 으로 방출하게 된다. 스위 칭 주기 TS를 한 주기로 하여 이 동작이 반복되면서 입력전원을 우리가 원하는 출력전력으 로 변환하게 된다.4. 실습 계획서4-1 PWM칩(UC ... 3845)을 이용하여 아래 성능의 PWM 제어 회로를 설계하시오.- 출력전압 : 0 V ~ 10 V (peak to peak )- 스위칭 주파수 f : 12.5 kHz4-2 PWM

  리포트 | 11페이지 | 1,000원 | 등록일 2022.09.08 | 수정일 2022.09.14

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  A+ 중앙대 아날로그및디지털회로설계실습(결과)8. 래치와 플립플롭

  filter는 TV, radio 등에서 주파수를 선택하는 tunner에 많이 쓰이는 회로이며....(이 실험의 중요도, 필요성 등을 서술한다.)2. 실험결과8-4. 설계실습 내용 및 ... 실습 8. 래치와 플립플롭(학생이름, 학번, 학수번호, 실험조의 번호, 실험조원의 이름, 실험날짜, 제출날짜)요약 : 전자전기장비에 많이 사용되는 bandpass filter ... 를 R,L,C를 사용하여 설계하고 제작하였다. 설계에 사용된 수식을 PC의 EXCEL을 사용하여 simulation하고 그 결과를 실험치와 비교한결과 2%이하의 오차로 잘 일치하는 것

  리포트 | 5페이지 | 1,000원 | 등록일 2022.09.10

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  중앙대 아날로그및디지털회로설계실습 예비보고서 9장 4bit adder 회로설계

  아날로그 및 디지털회로설계 실습 예비보고서[설계실습 9. 4-bit Adder 회로 설계]소속담당교수담당조교수업시간학번성명? 조합논리회로(가산기): 2진수 2개를 더하는 경우 ... 를 출력으로 내야한다. 이러한 기능을 전가산기라 한다.9-1. 실습목적: 조합논리회로의 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계한다.9-2. 실습 준비물부품 ... (Bread board): 1개파워서플라이 (Power supply): 1대함수발생기 (Function generator): 1대점퍼선: 다수9-3 설계실습 계획서9-3-1 전가산기 설계

  리포트 | 6페이지 | 1,000원 | 등록일 2023.04.06

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  A+ 중앙대 아날로그및디지털회로설계실습(결과)7. 논리함수와 게이트

  된 부분에 이 번호를붙인다.)1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, pp 55-60 ... 다.2. 실험결과7-4. 설계실습 내용 및 분석7-4-1 설계한 논리게이트 구현 및 동작(A) Low(0) 값, High(1) 값, Vcc를 각각 0V, 5V, 5V로 설정 ... (예)의 형식으로 작성하되, 다음 사항을 검토하여 작성하라.- 본 설계실습에서 무엇을 하였으며 그 결과는 어떤가? 수치를 포함하여 요약한다. 설계실습계획서에서 설계한 회로와 실제

  리포트 | 5페이지 | 1,000원 | 등록일 2022.09.10

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 8차예비보고서-래치와 플립플롭

  ) : 3 개NAND gate(74HC00) : 6 개 오실로스코프 : 1 대 브레드보드 : 1 개 파워서플라이 : 1 대 함수발생기 : 1 대 점퍼선 : 다수3. 설계실습

  리포트 | 3페이지 | 1,000원 | 등록일 2021.10.06

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 4차예비보고서-신호발생기

  : 다수3. 설계실습 계획서3-1 신호발생기 설계(A) 그림 4-1 에 주어진 Wien bridge 회로에서 V+와 V-의 관계식을 구하시오. 이 관계식을 이용하여 1.63kHz ... 1. 실험 목적Wien bridge RC 발진기를 이용하여 신호 발생기를 설계, 제작, 측정하며 그 동작을 확인한다.2. 준비물Op amp (UA741CN) : 1 개 ... 에서 발진하는 Wien bridge 회로를 설계하시오.[V+와 V-의 관계식]- 그림 4-1 에서 Yc=1/jωC 로 두고 전압 분배 공식을 이용하자.[1.63kHz 에서 발진

  리포트 | 5페이지 | 1,000원 | 등록일 2021.10.06

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 9차예비보고서-4-bit Adder 회로 설계

  : 1 대 함수발생기 : 1 대 점퍼선 : 다수3. 설계실습 계획서3-1 전가산기 설계(A) 전가산기에 대한 진리표를 작성한다.- A=B=Cin=0 이면, S=Cout=0 - A ... 1. 실험 목적조합논리회로의 설계한다. 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로를2. 준비물 저항 (330Ω, 1/2W, 5%) : 10 개

  리포트 | 5페이지 | 1,000원 | 등록일 2021.10.06

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  중앙대 아날로그 및 디지털 회로 설계 실습 3학년 2학기 카운터 설계 과제 14주차

  아날로그 및 디지털회로 설계 실습14주차 과제: 카운터 설계1. RS-Latch를 이용한 Chattering 방지회로를 설계하고 그 원리를 설명하시오.nand gate를 이용

  리포트 | 3페이지 | 1,000원 | 등록일 2021.06.28

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 5차예비보고서-전압제어발전기

  1. 실험 목적전압제어 발진기(VCO: Voltage Controlled Oscillator)를 설계하고 전압을 이용한 발진 주파수의 제어를 실험으로 확인한다.2. 준비물

  리포트 | 9페이지 | 1,000원 | 등록일 2021.10.06

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  [중앙대 아날로그및디지털회로설계실습]설계실습2(Switching Mode Power Supply(SMPS)) 결과보고서

  의 출력의 Duty rate D에 의해 SMPS의 출력이 결정되는 SMPS의 동작원리를 이해할 수 있었다.2. 설계실습 결과(1) PWM 제어회로① PWM 제어회로를 구성한다.설계실습 ... us)임을 확인했다. (사진에 출력, 주기 빨간 팬으로 표시)(2) Buck Converter① Buck Converter 회로를 구성한다.설계실습 계획 시 설계한대로 Buck ... 까지의 설계실습을 통해 L, C가 포함된 회로는 항상 오차가 컸던 것을 감안한다면 L, C 때문인 것 같다.(3) Boost Converter① Boost Converter 회로

  리포트 | 6페이지 | 1,000원 | 등록일 2020.08.11

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  중앙대 아날로그 및 디지털 회로 설계 실습 3학년 2학기 카운터설계(counter) 예비

  아날로그 및 디지털회로 설계 실습13주차 예비: 카운터 설계전자전기공학부20160000 하대동고릴라1. 4진 비동기 카운터이론부의 그림 14-2의 비동기식 4진 카운터에 1MHz ... (MHz), 0.25(MHz)이다.2. 8진 비동기 카운터 설계8진 비동기 카운터의 회로도를 그린다. 단, CLK 입력에 클럭 입력 대신 버튼 스위치를 연결하여 버튼을 누를 때 ... 마다 카운트가 증가하도록 설계한다. 또한, Q1, Q2, Q3 출력 신호에 LED를 연결하여 카운터의 상태에 따라 LED에 불이 들어오도록 연결한다.교재에는 BL-R2131H가 준비물

  리포트 | 5페이지 | 1,500원 | 등록일 2020.12.23

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  중앙대 아날로그및디지털회로설계실습 예비보고서 8장 래치와 플립플롭

  아날로그 및 디지털회로설계 실습 예비보고서[설계실습 8. 래치와 플립플롭]소속담당교수담당조교수업시간학번성명? RS 래치RS 래치 회로도: 교차교합(Cross-coupled)된 두 ... (Oscilloscope): 1대브레드보드 (Bread board): 1개파워서플라이 (Power supply): 1대함수발생기 (Function generator): 1대점퍼선: 다수8-3 설계실습 ... 방정식:Q ^{+} =S+ {bar{R}} Q (Q ^{+}는 다음 순간의 출력Q를 의미한다.)8-1. 실습목적: 순차식 논리회로의 기본 소자인 래치와 플립플롭의 여러 종류에 대한

  리포트 | 4페이지 | 1,000원 | 등록일 2023.04.06

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 6차예비보고서-위상 제어 루프(PLL)

  : 1 대브레드보드 : 1 개파워서플라이 : 1 대함수발생기 : 1 대점퍼선 : 다수3. 설계실습 계획서3-1 위상제어루프의 용도이론부의 위상 제어 루프를 이해하여 요약, 설명

  리포트 | 11페이지 | 1,000원 | 등록일 2021.10.06

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 1차예비보고서-초전형 적외선 센서

  를 설계한다. 2. 준비물적외선 센서 (RE200B) : 1 개Op-Amp (UA741CN) : 2 개LED : 1 개커패시터 10nF, ceramic disk : 1 개커패시터

  리포트 | 3페이지 | 1,000원 | 등록일 2021.10.06

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  중앙대학교 아날로그및디지털회로설계실습(3-2) A+ 3차예비보고서-스텝모터구동기

  %) : 4 개스위치 : 3 개LED : 4 개오실로스코프 : 1 대브레드보드 : 1 개파워서플라이 : 1 대함수발생기 : 1 대점퍼선 : 다수3. 설계실습 계획서3-1 스텝 ... register)의 사용 방법을 배운다. 이를 바탕으로 BJT 트랜지스터와 범용 이동 트랜지스터를 이용하여 스텝 모터 구동기를 설계한 후 그 동작을 확인한다.2. 준비물4 비트 범용

  리포트 | 8페이지 | 1,000원 | 등록일 2021.10.06

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  [A+]중앙대 아날로그및디지털회로설계 실습 예비보고서9 4bitadder

  1. 실습을 위한 이론적 배경:-부울 대수 : 변수, 상수, 연산자, 기본 공리 및 정리로 구성되어 있으며 부울 대수에 나타날 수 있는 상수 값은 0과 1 뿐이다. 현대 ... 이 성립한다. : 논리곱을 논리합으로 논리합을 논리곱으로 바꿔주는 법칙으로 NOR은 보수 입력의 AND 게이트로 나타낼 수 있다는 뜻이다.ㄴ4. 실습 계획서4.1 전가산기 ... 설계A 전가산기에 대한 진리표를 작성한다.B Karnaugh 맵을 이용하여 간소화 된 Sum of product 또는 Product of sum 형태의 불리언 식을 구한다.C

  리포트 | 10페이지 | 1,000원 | 등록일 2022.09.08

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