booth algorithm을 응용하여 연속된 1이 있을 경우 빠르게 연산하는 곱셈기의 설계도 입니다.
환경은 Verilog HDL이며, verilogger나 모델심으로 구동합니다. 모듈간의 구분은 파일로 나누었으며, 각각의 instantiation은 top에서 물려 있습니다.
본문내용
베릴로그로 기술된 booth 알고리즘의 8비트 곱셈기 설계
booth algorithm을 응용하여 연속된 1이 있을 경우 빠르게 연산하는 곱셈기의 설계도 입니다.
환경은 Verilog HDL이며, verilogger나 모델심으로 구동합니다. 모듈간의 구분은 파일로 나누었으며, 각각의 instantiation은 top에서 물려 있습니다.
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